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      Entretien pour Hardware Digital Design Engineer

      3 mars 2024
      Candidat à l'entretien anonyme
      Aucune offre
      Expérience positive
      Entretien moyen

      Candidature

      J'ai postulé en ligne. Le processus a pris 4 semaines. J'ai passé un entretien chez Qualcomm

      Entretien

      Talking to a recruiter for 45 mins, He asked about details of my projects and related topics like comp arch, hardware acceleration. He then asked about blocking and non blocking in verilog and basic digital design concepts like cdc, FIFO, metastability. No verilog coding.

      Questions d'entretien [1]

      Question 1

      what's the frequnecy you used for your design, how did you tested your design. Explain area speed trade off situation you met in your design
      Répondre à cette question