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      Entretien pour ASIC Design and Design Verification Engineer

      27 juill. 2012
      Candidat à l'entretien anonyme
      Markham, ON

      Autres retours d’entretien d’embauche pour un poste comme ASIC Design and Design Verification Engineer chez Qualcomm

      Entretien pour ASIC Design Verification Engineer

      20 déc. 2024
      Candidat à l'entretien anonyme
      Aucune offre
      Expérience positive
      Aucune offre
      Entretien moyen

      Candidature

      J'ai postulé via la recommandation d'un employé. Le processus a pris plus d'une semaine. J'ai passé un entretien chez Qualcomm (Markham, ON) en mai 2012

      Entretien

      3 rounds of interviews from different groups, from 11am to 4pm, including lunch time.

      Questions d'entretien [1]

      Question 1

      they focused a lot on OOP, which is unexpected given the title that I applied.
      1 réponse
      Entretien moyen

      Candidature

      J'ai postulé via la recommandation d'un employé. J'ai passé un entretien chez Qualcomm en avr. 2024

      Entretien

      They asked me a riddle. I was tested on various digital design concepts, some C++, writing SystemVerilog concepts based on simulation output, general verification concepts (no UVM yet). i was also asked about my long term goals and to what extent i understand the company's work.

      Questions d'entretien [1]

      Question 1

      I can't say exactly but one SystemVerilog question was to implement a finite state machine given a certain output. Review sequence detectors.
      Répondre à cette question

      Entretien pour ASIC Design Verification Engineer

      17 avr. 2021
      Candidat à l'entretien anonyme
      Dublin, Dublin
      Aucune offre
      Expérience positive
      Entretien moyen

      Candidature

      J'ai postulé en ligne. J'ai passé un entretien chez Qualcomm (Dublin, Dublin) en mars 2021

      Entretien

      1st round was technical interview, I applied for the role two days back and got shotlisted very quick. I applied through Linkedln. The interviewers were very gentle and the hiring process was very smooth.

      Questions d'entretien [1]

      Question 1

      Basic electronics question - 2:1 Mux, truthtable, DFF, FPGA design flow
      Répondre à cette question

      Entretien pour ASIC Design Verification Engineer

      28 janv. 2021
      Candidat à l'entretien anonyme
      San Diego, CA
      Aucune offre
      Expérience positive
      Entretien moyen

      Candidature

      J'ai postulé en ligne. J'ai passé un entretien chez Qualcomm (San Diego, CA) en janv. 2021

      Entretien

      It was 5 stage virtual interview process with 5 different people from the team. It was my first virtual interview and it was really a different exposure rather than phone interview.

      Questions d'entretien [1]

      Question 1

      All the interviewers are Indians and were really nice. I had a really good conversation each interview is about an hour. Everyone had a set of questions prepared and asking me to solve. 1. Full SV - fork join_none, virutal functions, $cast, static variable, Cache size - direct mapping, MESI FSM, constarints, parity check - post randomize 2. STA - hold violations, max freq, FIFO depth, metasibility 3. DUT - muti master muti slave bridge verification - draw the env and testcases, AXI signals 4. UVM - phases, AXI why not APB?, AXI lite vs. AXI 3.0, Driver code, coverage class and do cross coverage. 5. HR -> about team work, resources you used in a project, set back you faced. Explained most employee benefits, applying for H1B and green card, etc
      1 réponse